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使用華菱光電CIS傳感器設(shè)計(jì)的高速圖像采集設(shè)備
  來源：www.xwseo.cn

通過使用線性圖像傳感器CIS采集的圖像判斷產(chǎn)線上的鋁箔是否有污點(diǎn)像一棵樹、裂痕共享、氣孔首要任務、褶皺等等問題實踐者，傳統(tǒng)是通過人眼觀察或者工業(yè)相機(jī)檢查幅度，人眼觀察主要由于抽檢工藝技術，無法做到實(shí)時監(jiān)測自行開發，工業(yè)相機(jī)的問題是為了獲得足夠?qū)挼呐臄z角度影響力範圍，相機(jī)距離被測物體較遠(yuǎn)大局，設(shè)備產(chǎn)生的震動、粉塵應用提升、照明光線等都會影響采集效果主動性，而且無法做到高速檢測創造性，鏡頭的畸變也會影響檢測效果。

選用的華菱光電CIS傳感器道路，分辨率為300DPI時規模設備，一行像素有3672個，采樣圖像寬度在30cm左右指導，這個分辨率可以采集出的圖片達(dá)到4K級別競爭力，這個是一般工業(yè)相機(jī)很難達(dá)到的。

FPGA將采集的信號通過千兆網(wǎng)輸出到計(jì)算機(jī)進一步完善，千兆網(wǎng)芯片選用的是RTL8211集聚，由于開始設(shè)計(jì)的框圖想用高速USB接口，結(jié)果由于驅(qū)動問題太麻煩調整推進，改成了千兆網(wǎng)進(jìn)行傳輸狀況。

其中麻煩的地方在于數(shù)據(jù)采集的時序和圖像校正，先看一下傳感器時序圖機製。


CLK：2MHz時鐘

SI：開始采集信號

LEDg/r/b：傳感器自帶RGB三色補(bǔ)光燈 

SIG：傳感器輸出的模擬信號建立和完善，分為三段，相當(dāng)于一根傳感器是三個傳感器組成的

ADC采集芯片選用的是AD9822參與水平，這個芯片主要由于CCD/CIS的圖像采集大型，性能優(yōu)秀，下面是時序圖明確相關要求，芯片也是分3通道采集重要意義，可以對應(yīng)RGB通道。


CDSCLK2：采樣點(diǎn)

ADCCLK：ADC數(shù)據(jù)輸出時鐘（由CPLD提供深化涉外，同時采樣3通道體系，即頻率為采樣點(diǎn)的3倍）

OUTPUTDATA：并行輸出數(shù)據(jù)

我們用來采集傳感器的3個部分，經(jīng)過AD轉(zhuǎn)換后在進(jìn)行數(shù)據(jù)重新排序和拼接服務延伸。

在3通道SHA模式下共創輝煌，AD9822同時采樣SIG1，SIG2和SIG3輸入電壓進一步。采樣點(diǎn)由CDSCLK2控制大部分。 CDSCLK2的下降沿對每個通道上的輸入波形進(jìn)行采樣[A1] 。來自三個SHA的輸出電壓由DAC修改實際需求，然后由三個PGA縮放解決方案。然后PGA的輸出通過14位ADC多路復(fù)用。 ADC在ADCCLK的下降沿順序采樣PGA輸出善謀新篇。

OFFSET引腳可以用作粗偏置調(diào)整引腳增產。在AD9822的一級放大器中，從施加到SIG1方法，SIG2和SIG3輸入的電壓中減去施加到該引腳的電壓行動力。在這種模式下提供有力支撐，輸入鉗位被禁用。有關(guān)更多信息保供，請參見電路操作部分自行開發。

CDSCLK1應(yīng)在該模式下接地。盡管不是必需的責任，但建議CDSCLK2的下降沿與ADCCLK的上升沿同時發(fā)生或在ADCCLK的上升沿之前發(fā)生應用情況。如tADC2所示，CDSCLK2的上升沿不應(yīng)出現(xiàn)在先前的ADCCLK下降沿之前組建。輸出數(shù)據(jù)等待時間為三個ADCCLK周期表現。

SIG1，SIG2和SIG3通道的偏移和增益值是使用串行接口編程的首次。通過對MUX寄存器進(jìn)行編程可能性更大，可以選擇通過多路復(fù)用器切換通道的順序。

PGA方案，offset參數(shù)需要根據(jù)測試結(jié)果調(diào)節(jié)關鍵技術，可以先設(shè)置為最小了解情況，逐漸增加深入。

采樣效果如下：

由于被測物體時灰色，一般工業(yè)攝像機(jī)都很難看清細(xì)節(jié)重要的，比如微小的劃痕和裂縫開展研究，但是華菱光電的CIS傳感器就可以很好的捕捉到各種細(xì)節(jié)。
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